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一种能效高、可抵御旁道攻击的高级加密标准 (AES) 算法的并行 ASIC 实现
应用领域:电子信息
我有意向
国家/地区
土耳其
行业领域
电子信息
简介

在日益互联的世界里,加密变得比以往任何时候都更加重要。高级加密标准 (AES) 凭借其数学特性,在 20 多年后仍被认为是安全的。然而,旁道攻击 (SCA) 威胁着不适当的 AES 实现。本文介绍了不同的 AES 实现,并展示了它们对功率 SCA(即相关功率分析 (CPA) 攻击)的抵抗力。为了提高能源效率,通过寄存器级组织和与流程相关的优化,将因对抗 SCA 而增加的额外功能导致的功耗增加降到最低。不同的 AES 实现是通过 Cadence ASIC 流程(TSMC 65 nm LP 技术)构建和处理的。使用 ChipWhisperer 平台对 SCA 抵抗力进行评估,该平台在 RTL-to-GDSII 流程后获得的实际功耗值上运行。结果表明,流水线化和展开 AES 轮次会增加 SCA 抵抗力,但代价是能源效率略有降低。所提出的实现适用于不同的旁道攻击对策。

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